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逻辑险象
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This paper describes logic design with synchronous theory. Synchronizingis very important to improve utilities of CPLD resouces, and to avoidlogic disorder resulted by asynchronous design. An example of statemachine is given.

本文介绍了利用同步时序逻辑的思想进行逻辑设计,以提高CPLD逻辑资源的利用率,消除异步逻辑所产生的逻辑险象,并给出了一个状态机设计实例

 
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