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butterfly-unit
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This paper demonstrates an efficient method for constructing array coprocessors for 1-D Walsh transform. This method easily constructs an array coprocessor for 22t point transform with 2t chips, each with 2t points, and an array coprocessor for 22t+1 point transform with 2t+1 chips, each with 2t points, and 22t butterfly units.

本文给出了一种用短序列Walsh变换芯片构成长序列Walsh变换阵列协处理器的方法.按此法,易用2~t片2~t长芯片构成2~(2t)长的Walsh变换的阵列协处理器,并且易用2~(t+1)片2~t长芯片及2~(2t)个蝶形运算器构成2~(2t+1)长的Walsh变换的阵列协处理器.

In this paper,howto design FFTmodules by using FPGA is researched.Based on the principle and implementation methods of FFT,the whole structure,butterfly unit and the performance are discussed.

在对FFT(快速傅立叶变换 )算法进行研究的基础上 ,描述了用FPGA实现FFT的方法 ,并对其中的整体结构、蝶形单元及性能等进行了分析。

FFT algorithm is the most used algorithm for digital signal processing, and a FFT processor is one of the important means for FFT computation. Aim at the main_base 16 local piple_line butterfly unit, this paper proposes a novel address mapping method applied in a high_radix FFT processor, a variable length FFT computation from 16 to 4096 point can be done by this method. The method has such features as agility, high computation speed and simple architecture and it well meets the control of the data channel of...

FFT algorithm is the most used algorithm for digital signal processing, and a FFT processor is one of the important means for FFT computation. Aim at the main_base 16 local piple_line butterfly unit, this paper proposes a novel address mapping method applied in a high_radix FFT processor, a variable length FFT computation from 16 to 4096 point can be done by this method. The method has such features as agility, high computation speed and simple architecture and it well meets the control of the data channel of FFT processor.

FFT算法是数字信号处理最常用算法,使用FFT处理器是进行FFT运算的重要手段之一。本文针对主基16局部流水的FFT处理器,提出了一种运用于高基FFT处理器的新型地址产生结构,能够进行16~4096点可变长的FFT运算,具有快速灵活的特点,且结构简单,适合FFT处理器中对数据通路控制的实现。

 
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