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   bit error tester 的翻译结果: 查询用时:0.006秒
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bit error tester
相关语句
  误码仪
     Research and Design of Bit Error Tester Based on Small RTOS51 and FPGA
     基于Small RTOS51和FPGA的误码仪的研究与设计
短句来源
     The Research and Design of Bit Error Tester Based on FPGA
     基于FPGA的误码仪的研究与设计
短句来源
     Bit error tester is indispensable equipment during performance testing and malfunction diagnosis of communication system.
     在通信系统的性能测试以及故障诊断工作中,误码仪是必不可少的设备。
短句来源
  误码仪内核
     Bit Error Tester Design based on FPGA
     基于FPGA的误码仪内核设计
短句来源
  “bit error tester”译为未确定词的双语例句
     In order to improve the system's integration and function expansion, bit error test sub-system is designed based on FPGA and application program of intelligent user interface sub-system is based on embedded operation system to achieve real time process. Old Bit Error Tester technique is studied。
     提出采用FPGA进行误码测试子系统模块设计,提高了系统功能扩展性和系统的集成度,使用嵌入式操作系统进行系统应用软件设计提高系统实时性。
短句来源
  相似匹配句对
     Bit Error Tester Design based on FPGA
     基于FPGA的误码仪内核设计
短句来源
     Design and realization of programming bit error rate tester
     可编程误码仪的设计与实现
短句来源
     The Research and Design of Bit Error Tester Based on FPGA
     基于FPGA的误码仪的研究与设计
短句来源
     A Control Design for the Kernel of Error-bit Tester
     一种误码仪控制方案的实现
短句来源
     Design and realization of bit error ratio tester based on FPGA
     基于FPGA的误码率测试仪的设计与实现
短句来源
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    我想查看译文中含有:的双语例句
例句
没有找到相关例句


The bit Error Tester design based on high performance FPGA chip is presented.The chip PLL is used to provide internal global clock,and VHDL is used as programming language to realize three kinds of PN code with speed from 1M to 20M for test.You can insert manual error bit and reset system automatically or manually.The simulation result is given finally.

实现了一种基于FPGA的误码仪内核设计,利用FPGA芯片内部的PLL提供高速全局时钟,使用硬件编程语言VHDL编程实现了传输速率在1~20 M b/s内分段可调,29-1位、215-1位、223-1位3种序列长度的伪随机码码型可选,可手动发送误码以及智能失同步置位的误码检测等误码仪主要功能,并在最后给出了仿真结果。

 
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